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これはCPLDアーキテクチャに基づくプログラマブル論理デバイスで、72個のマクロセルと1600個の使用可能なゲート回路を内蔵しています。ユーザーがハードウェア記述言語を通じてデジタル論理機能をカスタマイズすることをサポートし、インターフェース変換、タイミング制御、アドレスデコードおよびシステムの「接着論理」統合を実現するために使用されます。